Marvell与Siemens EDA展示CoWoS验证新法
Marvell与Siemens EDA在TSMC OIP论坛展示3D IC CoWoS系统验证新方法,旨在解决先进封装中的ESD与可靠性挑战。
技术生态合作进展,对现货价格无直接影响。
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Marvell与Siemens EDA在TSMC OIP论坛展示3D IC CoWoS系统验证新方法,旨在解决先进封装中的ESD与可靠性挑战。
技术生态合作进展,对现货价格无直接影响。
台积电LC Lu在OIP论坛提出AI芯片设计路线图,聚焦纳米片晶体管与先进封装。为解决AI训练与推理的功耗瓶颈,路线图强调逻辑与内存集成及光互连技术。
长期技术演进利好先进封装与HBM产业链,但短期无具体供需数据。
台积电将微通道冷却纳入研发路线图,以解决AI芯片功耗激增的问题(5年内6倍)。随着封装功耗从600W增加到4100W,行业正从风冷转向液冷。
该技术代表了先进封装的长期方向,但制造挑战意味着短期内不会出现供应中断。
英伟达计划于2028年下半年量产代号“费曼”的下一代GPU,采用台积电A16工艺。该芯片将结合SoIC 3D堆叠、CoWoS-L封装及CPO光互连技术,并导入定制化HBM4E内存。
未来先进封装与光互连产能布局。
台积电与阳明交大团队开发出0.42纳米氧化铝界面,用于单层二硫化钼晶体管。该技术解决了二维半导体栅极介电层成核难题,实现了强电场控制与低漏电。
该技术属于基础研发突破,目前对现货价格及供需无直接影响。
台积电CoWoS-L良率达98%,可支持5.5倍光罩尺寸芯片量产。这是该技术首次在量产规模下处理5.5倍光罩尺寸芯片。
台积电2029年14倍光罩尺寸封装技术的量产进度。
TSMC面板级封装CoPoS与Intel EMIB技术对比,前者旨在提升AI加速器面积利用率,后者通过局部硅桥降低互连成本。CoPoS可支持更大尺寸的AI加速器,但电气性能与良率数据尚不明确;EMIB已量产多年。
两者在电气性能与制造工艺上存在不同权衡,影响未来高带宽内存封装方案选择。
Intel在IEEE ECTC展示EMIB-T技术以应对晶体管密度放缓并挑战TSMC的CoWoS领先地位。随着封装技术触及极限,芯片制造商正转向新的集成方案。
该技术路线图更新尚未对当前供应或价格产生直接影响。
AI封装瓶颈正从基板向硅片级集成转移。CoWoS架构虽成熟但暴露了现代封装堆栈的极限。此为技术趋势分析,暂无直接价格影响。
文章提出AI光子学需关注电光实现走廊(EORC)概念。单一器件性能不足以支撑AI基础设施,需整合热学、力学及材料约束。
该框架将推动硅光子及共封装光学技术向系统级集成发展。
台积电在2026年欧洲技术研讨会上公布A12、A13及N2U工艺路线图,目标在先进封装中提升48倍晶体管密度。此次更新通过设计-技术协同优化(DTCO)和背供电技术,旨在提升能效并支持未来AI算力需求。
该路线图虽预示未来先进制程需求,但未涉及当前现货价格或产能变动。
黄仁勋称华为的Tau Scaling Law为突破,但未对TSMC构成威胁。华为LogicFolding技术旨在通过堆叠电路层实现高性能,预计2026年应用于Kirin芯片。
黄仁勋的评论缓解了对TSMC先进封装业务的担忧,但华为量产的不确定性限制了短期影响。
英特尔18A-P工艺在同等性能下功耗降低18%,TSMC A16将于6月VLSI大会亮相。此次VLSI大会被视为英特尔与台积电在先进制程领域的关键对决,双方均展示GAA等新技术。
苹果对英特尔18A-P的潜在采用意向,这可能改变未来先进制程的竞争格局。
台积电公布A14、A13及2nm家族路线图,A14预计2028年量产。Mii强调通过纳米片技术及NanoFlex Pro提升性能与能效。
技术路线图更新,暂无短期供需影响。
三星在IEEE展示了基于CXL 2.0标准的Pangea v2内存系统,宣称性能较RDMA提升高达10.2倍。SK海力士与美光亦在推进CXL研发,三星计划2026年内推出基于CXL 3.2的Pangea v3。
此为长期技术路线图,对当前组件供应、价格及交易决策无直接影响。
台积电COUPE硅光平台目标2026年量产,三星晶圆代工计划2027年推出光引擎、2029年提供CPO交钥匙服务。背景是GPU互连需求推动光传输技术发展,两家代工厂竞相布局。
/利多/关注: 中性,此为远期技术路线图,对当前电子元件交易无直接影响。
英伟达计划于2027年推出的Rubin Ultra GPU设计,因采用四芯片及16个HBM4E模块的封装方案,在台积电CoWoS-L封装中遭遇翘曲问题。台积电需探索CoPoS等替代封装方案以解决技术瓶颈。
该技术障碍为高端AI加速器的远期供应带来不确定性,可能影响相关先进计算组件的长期采购策略。
日本设备商Rix计划最早于2026年量产面向2.5D/3D封装(如CoWoS)的先进清洗设备。该技术旨在解决AI芯片封装中微米级间隙的清洗难题,公司已获得部分订单。
此为针对特定工艺环节的长期产能规划,对当前芯片供应及价格无直接影响。
业界拟将HBM高度限制放宽至800µm以容纳20层堆叠。此举旨在降低晶圆减薄风险,但混合键合导入恐延后。
混合键合延后或影响下一代HBM密度量产节奏。
英特尔EMIB封装技术因台积电CoWoS产能紧张而获得关注,其供应链投资随之复苏。该技术路线预计在2026年下半年迎来关键转折点。
此为针对先进封装供应的长期、间接的产能多元化布局,对当前价格无直接影响。
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All teardowns| Analog | $0.68 | −5.9% |
|---|---|---|
| Connector | $0.75 | +0.2% |
| CPU | $386.74 | −21.3% |
| DDR4 | $88.40 | −0.2% |
| DDR52026-W13 | $14.89 | −11.2% |
| GPU | $478.20 | +8.2% |
| MCU | $0.68 | −61.7%Unusual |
| MLCC | $0.01 | +54.0%Unusual |
| MOSFET | $0.12 | −82.8%Unusual |
| PMIC2026-W13 | $0.44 | −12.5% |
| SSD/HDD | $288.43 | n/a |