ClockEdge探讨时钟网络仿真技术,优化30%芯片功耗
ClockEdge CTO Zakir Syed介绍其专用于半导体时钟网络的仿真技术,旨在解决复杂设计中保持晶体管级精度的难题。时钟分布网络通常占芯片总功耗的约30%,且电源噪声和波形失真会严重影响时序裕度。
该技术有助于工程师区分真实电气风险与保守假设,从而优化PPA(性能、功耗、面积)目标。
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ClockEdge CTO Zakir Syed介绍其专用于半导体时钟网络的仿真技术,旨在解决复杂设计中保持晶体管级精度的难题。时钟分布网络通常占芯片总功耗的约30%,且电源噪声和波形失真会严重影响时序裕度。
该技术有助于工程师区分真实电气风险与保守假设,从而优化PPA(性能、功耗、面积)目标。
JEDEC发布首个硅光可靠性标准JESD264,规范调制器与波导测试。该标准填补光学测试空白,解决多芯片模块的热应力与对准问题。
(技术标准化推动行业应用,短期供需无显著变化)。
台积电LC Lu在OIP论坛提出AI芯片设计路线图,聚焦纳米片晶体管与先进封装。为解决AI训练与推理的功耗瓶颈,路线图强调逻辑与内存集成及光互连技术。
长期技术演进利好先进封装与HBM产业链,但短期无具体供需数据。
AMD在Linux驱动中增加GDDR7支持,确认RDNA 5架构开发。此次更新涉及IH 8.0、NBIF 7.10等新IP模块,但未提及具体产品发布时间。
虽为技术预研,但预示未来GPU及高带宽内存需求预期。
密歇根大学推出Fengshui框架优化芯粒组合与ASIC设计。该框架旨在降低AI加速器的能耗与设计成本。
长期技术趋势。
文章描述了一种单一软件控制内核的处理器架构,在一个执行流水线中处理矩阵、向量和标量代码。这是半导体工程报道的一种新型处理器技术趋势。
该技术有望推动未来处理器架构创新,但短期内对现货价格无直接影响。
Velaura公司宣称其技术可将AI算力功耗降低2X至4X。该技术主要针对算术计算单元,占XPU功耗的40%-70%。
随着算力成为AI瓶颈,能效提升有望刺激相关芯片需求。
英特尔18A-P工艺通过Power Boost和应变工程,将RibbonFET和PowerVia性能提升至第一代以上,功耗降低18%,开关速度提升12%。该工艺在保持设计兼容性的前提下,通过优化接触电阻和互连层,实现了更高的晶体管驱动电流。
该技术升级将增强英特尔代工服务的长期竞争力,但短期内对现货市场价格无直接影响。
Architect Labs在两周内完成了名为Redwood的AI加速器验证,该芯片专为边缘设备设计。尽管基于三星8nm工艺的模拟数据显示其性能优于Nvidia Jetson Orin Nano,但目前仍为FPGA原型。
三星zHBM散热降低50%且密度提升10倍,液冷技术在AI芯片中的渗透率预计升至60%。随着3D堆叠加剧散热挑战,行业正加速转向CPO和STCO解决方案。
先进封装与液冷技术需求。
神经形态芯片因融合存储与计算架构而面临侧信道攻击等安全挑战。与传统处理器不同,这种脑机架构使硅片和时序电路暴露于新型网络威胁之下。对当前交易决策无直接影响。
英伟达扩展Agent工具包,新增PhysicsNeMo物理AI层与CUDA-X数值计算库。该工具旨在构建自主工程系统,连接推理模型与物理仿真及EDA工具。
关注EDA软件与AI算力需求趋势。
Blaize推出Graph Streaming Processor (GSP)架构,旨在减少AI推理中的数据移动。该公司主张通过混合AI策略,利用硬件调度器优化数据流,而非单纯堆砌算力。
目前仅处于技术概念阶段,对短期现货价格无直接影响,属于AI芯片架构创新趋势。
吕贝克大学研究人员发布SPARC框架,用于预硅片电源侧信道泄漏的自动化根本原因分析。该工具利用宏单元级信息流跟踪增强阴影逻辑,以标记开关活动并定位泄漏源。
此技术进展属于研发范畴,目前对现货市场价格及供应链无直接冲击。
英伟达部署Vera处理器加速下一代CPU和GPU的EDA流程,旨在应对日益增加的芯片设计复杂度挑战。
(关注):提升研发效率,但无直接供应影响。
BEOL集成磁技术通过在CMOS晶圆上沉积磁薄膜和导电绕组,将无源元件嵌入半导体制造工艺。该技术利用标准金属互连步骤和低温沉积工艺,制造平面螺旋或环形微型电感器,减少寄生电阻和电感。
文章指出触觉感知是物理AI的关键瓶颈,机器人需通过多模态传感实现安全交互。这预示着触觉传感器和力传感器在机器人领域的需求将显著增长。
触觉传感器需求前景看好。
台积电A14工艺性能与256Mb SRAM良率逼近90%,较四月提升约5%与10%。得益于N2代GAA技术的经验积累,A14开发进度显著快于N2。
AI与HPC客户强劲需求,但良率提升可能缓解未来供应压力。
NUS等机构联合发布室温CMOS兼容量子光子芯片设计报告。该研究利用标准CMOS工艺实现室温单光子处理,降低量子计算门槛。
技术趋势,短期无供需影响。
SK海力士、TetraMem与南加州大学合作开发基于忆阻器的存内计算SoC。该芯片旨在提升边缘AI能效,但理论峰值仅2.54 TOPS,远低于Copilot+要求。
作为实验性技术验证,目前对现货价格及供需无直接影响。
Whose chips are really inside the hottest new products? We open them up and show you, one part at a time.
All teardowns| Analog | $0.68 | −5.9% |
|---|---|---|
| Connector | $0.75 | +0.2% |
| CPU | $386.74 | −21.3% |
| DDR4 | $88.40 | −0.2% |
| DDR52026-W13 | $14.89 | −11.2% |
| GPU | $478.20 | +8.2% |
| MCU | $0.68 | −61.7%Unusual |
| MLCC | $0.01 | +54.0%Unusual |
| MOSFET | $0.12 | −82.8%Unusual |
| PMIC2026-W13 | $0.44 | −12.5% |
| SSD/HDD | $288.43 | n/a |