ETH提出可编程内存控制器支持DRAM技术
ETH Zürich等机构提出“Terracotta”可编程内存控制器以促进新DRAM技术。该技术旨在解决DRAM在性能、能效和鲁棒性方面的限制,支持在DRAM内计算。
长期技术演进但无短期供需影响。
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ETH Zürich等机构提出“Terracotta”可编程内存控制器以促进新DRAM技术。该技术旨在解决DRAM在性能、能效和鲁棒性方面的限制,支持在DRAM内计算。
长期技术演进但无短期供需影响。
ChipAgents与ADI展示AI验证加速,Bug定位缩短至分钟级。面对芯片设计复杂度激增与工程人力不足的矛盾,Agentic AI通过多智能体系统优化验证流程。
该技术趋势主要提升研发效率,对短期供需与价格影响有限。
Z.ai开源ZCode并推出零数据保留选项,此前ZCode被曝打包本地代码库并尝试上传云端。
企业信任度受损,但无直接供应链影响。
伦斯勒理工学院与IBM Watson研究中心联合发布REACH技术,旨在降低HBM ECC控制器开销。该技术通过控制器管理长跨度纠错码,以应对HBM成本带来的更强保护需求。
HBM技术演进,对短期现货价格无直接影响。
Marvell扩内存去聚合策略以缓解AI基础设施瓶颈。该方案利用CXL、SSD及光互连技术解决内存限制。
技术趋势,暂无具体供需数据。
深度伪造技术近期显著进步,如Neil deGrasse Tyson与外星人对话的合成图像。该技术正变得更加逼真。文章主要讨论社会影响,对半导体供应链无直接数据支撑。
Signaloid CEO宣布将于2026年5月流片新ASIC,其UxHw技术旨在提升机器人与物理AI应用性能。该技术通过在运行时维护概率分布元数据,目标实现10至100倍性能提升。
目前属于技术趋势与研发背景,对现货市场供需无直接影响。
Siemens EDA在DAC 2026更新Questa One,引入AI驱动的验证和更快的引擎。该工具旨在提高SoC和3D IC设计的生产力,并集成Tessent DFT以缩短仿真时间。
(中性):该更新提高了设计效率,但尚未改变芯片的现货价格或供应基本面。
CXMT在AMD平台实现DDR5-8800超频,逼近SK海力士顶尖水平。尽管CXMT首颗DDR5 IC于2025年11月才发布,但已获Colorful等品牌采用。
技术突破显示国产存储竞争力提升,但短期对现货价格影响有限。
NVM Express联盟更新11项NVMe规范,新增PCIe导出NVM子系统迁移功能。该功能旨在简化虚拟机迁移并支持后量子密码学,提升存储虚拟化能力。
技术规范升级利好NVMe SSD产业链长期发展,但短期无供需影响。
DAC 2026 Troublemaker Panel上,EDA高管展示AI设计流程成熟度,L5完全自主设计成为现实。John Cooley今年提问更侧重信息量而非娱乐性,嘉宾引用真实客户数据。利好EDA工具厂商长期技术竞争力,但短期无直接供需冲击。
BEOL集成磁技术通过在CMOS晶圆上沉积磁薄膜和导电绕组,将无源元件嵌入半导体制造工艺。该技术利用标准金属互连步骤和低温沉积工艺,制造平面螺旋或环形微型电感器,减少寄生电阻和电感。
第3部分详解CXL内存扩展器验证流程,涵盖系统RAM与设备DAX集成模式及调试工具使用。文章回顾了引导路径以区分传输缺陷与配置错误。
CXL内存扩展器技术验证进展。
三星计划2026年底量产CXL 3.2内存模块,SK海力士展示CXL 3.2样品。针对HBM和DDR容量瓶颈,两家厂商正开发CXL技术以扩展AI内存。
长期技术演进,对当前现货价格无直接冲击。
VerifAIX推出基于形式化验证的AI系统,旨在自动化芯片设计流程。该工具结合大语言模型与数学算法,解决传统验证中的信任与错误问题。
属于技术趋势,暂无明确的供需或价格影响。
Agentrys在DAC 2026发布Agentic Design Automation (ADA)平台,聚焦功能验证与物理实现。该平台旨在通过AI自动化工程工作流,并强调在现有基础设施上安全运行。
该技术趋势对EDA行业长期生产力的潜在影响。
Intel与谷歌云扩大合作,引入生成式AI加速芯片设计并优化供应链流程。双方利用谷歌云基础设施定制智能体工作流以提升效率。
该合作属于技术工具升级,暂未对半导体现货价格或产能产生直接冲击。
JEDEC发布JESD330-4标准,定义SPHBM4接口,利用4:1串行化将信号从2048降至512。该标准允许在有机基板上使用HBM4同款DRAM颗粒。
有机基板成本低于硅基板,有望降低HBM4模组成本并提升堆叠数量。
前NVIDIA研究员Mark Ren创立Agentrys并发布Agentic Design Automation (ADA)平台,旨在利用AI代理自动化芯片设计流程。该技术通过理解规格生成RTL和脚本,提升工程生产力。
Meta部署自研Vistara ASIC,将DDR4内存桥接至仅支持DDR5的AMD Turin服务器,单机总容量达1TB。针对DDR5价格飙升及供需失衡,Meta通过CXL 2.0技术回收旧服务器DDR4模块以降低硬件成本。
DDR4生命周期延长及CXL技术在企业级内存扩展中的应用趋势。
爆款新品里,到底装了谁的芯片?拆开,一颗一颗给你看。
全部拆解| Analog | $0.68 | −5.9% |
|---|---|---|
| 连接器 | $0.75 | +0.2% |
| CPU | $386.74 | −21.3% |
| DDR4 | $88.40 | −0.2% |
| DDR52026-W13 | $14.89 | −11.2% |
| GPU | $478.20 | +8.2% |
| MCU | $0.68 | −61.7%异常波动 |
| MLCC | $0.01 | +54.0%异常波动 |
| MOSFET | $0.12 | −82.8%异常波动 |
| PMIC2026-W13 | $0.44 | −12.5% |
| SSD/HDD | $288.43 | 暂无 |