CXMT发力服务器DRAM,目标年底量产DDR5
CXMT宣布采用4F²架构进军服务器DRAM市场,计划年底量产DDR5 RDIMM。该公司此前专注消费级内存,现瞄准三星和SK海力士主导的高端市场。
此举将加剧服务器DRAM市场竞争,长期可能对价格形成压力。
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CXMT宣布采用4F²架构进军服务器DRAM市场,计划年底量产DDR5 RDIMM。该公司此前专注消费级内存,现瞄准三星和SK海力士主导的高端市场。
此举将加剧服务器DRAM市场竞争,长期可能对价格形成压力。
Nvidia正在测试PTFE和HC树脂用于Rubin Ultra NVL576 Switch Tray,计划2027年下半年量产。此举旨在寻找玻璃基板替代材料以优化AI服务器性能。
PTFE及HC树脂材料供应商。
HBM4将接口翻倍至2048,带宽目标2.8TB/s。文章对比HBM与DDR5,指出AI算力受限于内存墙,HBM通过堆叠提升性能。
HBM技术迭代加速,但制造成本和散热挑战增加。
Meta通过CXL技术复用旧DDR4内存,将服务器数量削减25%。大多数厂商面临DIMM、功耗及遥测等技术陷阱,难以复制此策略。
DDR4新需求,但技术壁垒限制了大规模普及。
Defacto在SoC Compiler平台引入AI层,支持自动生成连接与版本对比。该功能已运行一年,旨在提升设计团队效率。
属于技术趋势,短期对供需及价格无直接影响。
Blaize推出Graph Streaming Processor (GSP)架构,旨在减少AI推理中的数据移动。该公司主张通过混合AI策略,利用硬件调度器优化数据流,而非单纯堆砌算力。
目前仅处于技术概念阶段,对短期现货价格无直接影响,属于AI芯片架构创新趋势。
NVM Express联盟更新11项NVMe规范,新增PCIe导出NVM子系统迁移功能。该功能旨在简化虚拟机迁移并支持后量子密码学,提升存储虚拟化能力。
技术规范升级利好NVMe SSD产业链长期发展,但短期无供需影响。
三星计划2026年底量产CXL 3.2内存模块,SK海力士展示CXL 3.2样品。针对HBM和DDR容量瓶颈,两家厂商正开发CXL技术以扩展AI内存。
长期技术演进,对当前现货价格无直接冲击。
JEDEC发布JESD330-4标准,定义SPHBM4接口,利用4:1串行化将信号从2048降至512。该标准允许在有机基板上使用HBM4同款DRAM颗粒。
有机基板成本低于硅基板,有望降低HBM4模组成本并提升堆叠数量。
德累斯顿工业大学研究人员发现认证TLS协议存在严重架构缺陷,允许攻击者将客户端连接静默重定向至恶意服务器。该漏洞影响英特尔TDX和AMD SEV-SNP等机密计算系统,CVSS评分高达7.5,目前官方尚未发布补丁。
此漏洞破坏了机密计算的信任机制,可能导致服务器采购延迟及市场对相关硬件的重新评估。
Meta部署自研Vistara ASIC,将DDR4内存桥接至仅支持DDR5的AMD Turin服务器,单机总容量达1TB。针对DDR5价格飙升及供需失衡,Meta通过CXL 2.0技术回收旧服务器DDR4模块以降低硬件成本。
DDR4生命周期延长及CXL技术在企业级内存扩展中的应用趋势。
Solidigm VP Avi Shetty 展望未来技术,包括 PCIe 6.0 SSD 和液冷存储。这是技术路线图讨论,而非供应链冲击。
Fraunhofer IZM展示了基于SiC MOSFET和AMB芯片嵌入技术的500 kW/l逆变器模块。该技术通过PCB嵌入和铜顶层金属化降低寄生电感,提升功率密度和热性能。
SiC功率器件封装技术,但当前对现货价格影响中性,属于研发里程碑。
随着AI服务器液冷方案普及,泵类组件设计重点从英伟达基准热设计扩展至多元化方案。供应商将泵效率优化作为提升冷却性能的关键杠杆,与流量和流速并列。
/中性:属技术演进背景信息,无具体产能削减、短缺预警或现货价格数据支撑,对近期交易决策无直接驱动。
三星、英特尔及台积电已启动2nm量产并规划1.4nm节点。台积电侧重差异化技术,三星聚焦良率,英特尔则激进推进GAA与High-NA EUV。
未来先进制程产能与技术路线图将重塑供应链格局。
三星、SK海力士、美光启动DDR6研发,速率目标17.6Gbps。DDR5在服务器市场占比超80%,DDR4占比跌至20%以下,业内讨论DDR4停产。
DDR5需求预期,利空DDR4长期前景,但DDR6商用尚早。
SK海力士、三星和美光正与JEDEC合作开发DDR6,目标是在2028年实现商业出货。该标准旨在实现高达17,600 MT/s的吞吐量,并采用新的4x24位子通道架构。
服务器平台将率先采用,随后是高端笔记本。
三星在IEEE展示了基于CXL 2.0标准的Pangea v2内存系统,宣称性能较RDMA提升高达10.2倍。SK海力士与美光亦在推进CXL研发,三星计划2026年内推出基于CXL 3.2的Pangea v3。
此为长期技术路线图,对当前组件供应、价格及交易决策无直接影响。
NEO半导体成功验证3D X-DRAM POC,利用3D NAND工艺实现HBM容量提升8倍至1.5TB。该技术旨在解决当前HBM供需紧张及高成本问题。
POC验证成功表明3D NAND基础设施可用于制造下一代DRAM,但商业化落地尚需时日。
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All teardowns| Analog | $0.68 | −5.9% |
|---|---|---|
| Connector | $0.75 | +0.2% |
| CPU | $386.74 | −21.3% |
| DDR4 | $88.40 | −0.2% |
| DDR52026-W13 | $14.89 | −11.2% |
| GPU | $478.20 | +8.2% |
| MCU | $0.68 | −61.7%Unusual |
| MLCC | $0.01 | +54.0%Unusual |
| MOSFET | $0.12 | −82.8%Unusual |
| PMIC2026-W13 | $0.44 | −12.5% |
| SSD/HDD | $288.43 | n/a |